全加器实验报告

全加器设计实验报告

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实验目的:

熟悉Quartus n原理图设计流程，学习简单电路的设计方法、输入 步骤、层次化步骤。

掌握QuartusII的文本输入方式的设计过程，理解 VHDIM言的结 构级描述方法，学习元件例化语句的设计方法。

实验原理：一位全加器可以用两个半加器及一个或门连接而成。要 求使用原理图输入的方法先进行底层半加器设计，再建立上层全加 器设计文件，调用半加器和或门符号，连线完成原理图设计。

全加器可以用两个半加器和一个或门连接而成，在半加器描述 的基础上，采用COMPONE时和PORT MA语句就可以很容易地编 写出描述全加器的程序。

一.原理医

半加器

实验步骤

打开Quartus II软件，选择新建命令，在新建对话框中选择原理 图文件编辑输入项，完成新建进入原理图编辑窗口。

在原理图编辑窗口任意位置右击鼠标，将出现快捷菜单，选择其

中的输入元件项insert symbol,按照所设计的电路，放置器件，排 版，连线，完成设计后选择另存为命令，命名为 h_adder存放在指

定文件夹中。

完成半加器的设计后，重复新建命令，开始进行全加器设计，在

新建的原理图中，双击鼠标，在弹出的窗口中选择 project选项,

全加器

实验步骤

新建工程，在新建的工程中建立 VHD均言编辑文件，在编辑窗口 处，输入设计的半加器全加器程序。

将设计好程序进行编译，没有错误之后定义全加器五个引脚所对 应耳朵硬件电路的引脚号。

烧录程序，调试，验证程序是否合理

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实验波形图:

1.半加器

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2.全加器

四.寄存器

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